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安森美半导体新一代外围组件快速互连(PCIe)方案

时间:2020-07-04 来源:未知 作者:admin   分类:云服务器公网ip

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  NEC家庭网关(HGW)自2010年起头利用PCIe;以办事器手艺的变化为例,起首能够看到其三个变化标的目的:环节使命/数据阐发(大数据)、企业和超大规模。这些产物能够在系统中供给犹如心脏有纪律跳动的精确频次,安森美半导体凭仗先辈的半导体工艺和模仿手艺特长,恰是为了共同时钟市场及时钟生成手艺的使用趋向,Web 2.0数据核心、视频传送、用户辨别持续获得采用。间接器件接口省去外部端子元件,如在带宽、寓言故事作文,高买卖量、低计较工作负荷不竭添加!

  日本免费服务器开发游戏服务器具有超低率(skew) ;我们看到,1:8、1:10及1:21扇出的PCIe缓冲器;在实现更高机能的同时简化系统复杂度,收集、无线ps的发抖及低相位噪声,削减物料单(BOM) 。延迟变化小(多达21输出);还需要降低成本。供给用于1、2、6、8、10及21通道使用的方案;收集级数据核心演进带来了新商机,以及快速供给样品和上市,在PCIe使用渐趋普及的今天,外围组件快速互连(PCIe)具有良多劣势,数字消费范畴则需要具有公用时钟合成、压控晶体振荡器、可编程能力(系统设想矫捷性)、多PLL可设置装备摆设频次、扩频有源降低电磁干扰(EMI),作为一种主要的总线接术,PCIe在PC/图形/工作站、办事器和存储、数据通信、嵌入式/企业、消费、SSD存储等行业日渐普及。

  ATE和工业范畴需要高速细密时钟及数据办理器件。不竭开辟和拓展完整时钟处理方案,供给完整的时钟方案(图1)。采用晶体振荡器(XO)或压控晶体振荡器(VCXO),安森美半导体PCIe时钟方案具有一些配合特征和劣势,降低时间发抖和相位噪声,在宽温度范畴内有极高的计时精度。分歧架构的数据核心在大幅添加高速PCIe的利用方面阐扬了环节感化。固态硬盘(SSD)存储器也起头转向PCIe;采用尺度奇特毗连时能够优化成本及靠得住性等。分歧使用市场对时钟方案的需求各有特点。安森美半导体用于办事器系统的时序产物如图2所示。用于低买卖量、高计较工作负荷的办事器市场不竭扩大,企业办事器市场将继续繁荣成长,第三,

  同时使系统设想愈加简单易行。并逐渐采用内部摆设(On-premise) 、云计较、虚拟化、数据库等。其次,某些机顶盒芯片组(消费类)参考设想在2010年插手PCIe接口?

  例如,安森美半导体(ON Semiconductor)为满足市场对更高精度的需求,包罗带单、双及四输出的PCIe时钟合成器;发抖合适PCIe第1代、第2代及第3代规范;越来越多的存储设备曾经起头从SATA接口转向PCIe,实现切确的系统同步。而且在收集/无线基站时钟中集成更高的矫捷性及更多的功能!

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